Parte 2 Flashcards

1
Q

A que se refiere Prefetchable en un request de espacio de memoria ?

A

Es una región de la memoria (MMIO) en la que se leen datos anticipadamente de manera especulativa para mejorar el performance de tal modo que si un requester solicita los datos leídos anticipadamente se le entreguen al instante.

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2
Q

Los dispositivos con 256B de registers/storage son accesados mediante que espacio?

A

Mediante IO Address space

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3
Q

Los dispositivos que tienen registers/ storage de 16KB se accesan con que espacio?

A

Del tipo MMIO

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4
Q

Cuales son los tipos de request de espacio que solicitan los dispositivos y se programa en el BAR?

A

Del tipo
[ 1 ] para IO requests
[ 0 ] para P-MMIO y NP-MMIO

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5
Q

De manera general como se inicializa un BAR?

A

Los bits menos significativos no son modificables (hard-coded) por el diseñador.

Los upper bits son de lectura/escritura en un inicio son Xs que indican que aún no se inicializa

Con config writes el software escribe en las Xs solo 1s para indicar que esos bits son programables.

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6
Q

Que es el DMI?

A

Direct Media Interface
Es un controlador lógico de alta velocidad para la transferencia entre el PCH y el CPU y que es transparente al software.

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7
Q

Que es el Root port (RP)?

A

Es el puerto saliente ubicado en el Root Complex (RC) es un P2P.

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8
Q

Que recomienda la especificación cuando un dispositivo requiere un rango de espacio Mayor a 4GB?

A

Que sean tratados como memoria y del tipo prefetchable es decir no side effects reads

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9
Q

Es el tipo de memoria que solo puede soportar direcciones de 32-bit y es del tipo [00] hard-coded. ?

A

La memoria NP-MMIO

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10
Q

Como se indica el rango de direcciones en un request IO.?

A

En los registros IO Base y IO limit que son de 16 bits

Ej. 4000h - 4FFFh

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11
Q

A diferencia de un BAR el tipo de request no se puede programar con 0s para indicar que no se utiliza ese request, que se hace en estos casos?

A

Se debe programar o asignar un valor en base mayor al del límite, de este modo el bridge detecta como algo inválido y asume que no hay un request presente.

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12
Q

Para que se configura un BAR y los registros de Base/Limit en el header.?

A

Para asegurar que el tráfico de los paquetes apuntan al target correcto y que la función será capaz de identificar y reclamar el paquete.

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13
Q

Cuales son los tipos de tráfico en la topología PCIE?

A

De la capa física Ordered Sets
Data Link Layer Packets (DLLPs)
Transaction Layer Packets (TLPs)

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14
Q

A que se refiere el tráfico peer-to-peer (P2P)?

A

Básicamente a los paquetes que envía un Endpoint hacia otro Endpoint

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15
Q

Menciona los tres tipos de routing que se utilizan?

A

Los TLPs pueden ser direccionados mediante:

Address ( memory y IO)
ID (con Bus, Device y Function number)
Implicit Routing

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16
Q

Que determina el tipo de ruteo a utilizar?

A

El tipo de TLP (paquete)

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17
Q

Menciona los tipos de transacciones (TLPs)?

A
Memory R/W
Memory read lock
AtomicOp
IO R/W
Messages
Completions
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18
Q

Que tipo de TLPs son mejor para Address routing ?

A

Memory R/W
AtomicOp
IO R/W
También algunos mensajes

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19
Q

Que ruteo se implementa en los TLPs de configuración R/W y para los Completions ?

A

Se utiliza un ID Routing y también para algunos mensajes

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20
Q

Que ruteo o routing se emplea para los mensajes ?

A

Los mensajes pueden utilizar los tres tipos de routing va a depender del tipo de mensaje

ID, Address e implicit routing

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21
Q

Cuál es el principal objetivo de implementar mensajes en PCIE ?

A

Para mejora del diseño es decir reducir el número de señales o side-bands que se utilizaban para:

Interrupt pins
Error pins
Power management signals, etc.

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22
Q

Que ventaja tiene el Split transaction protocol ?

A

Permite aceptar una o más solicitudes y responder a cada request con un completion distinto o por separado

23
Q

Por que las transacciones memory write son del modelo Posted?

A

Por que para reducir latencia que consume un completion. Significa que en cuanto sale del requester la transacción de escritura es marcada como completada.

24
Q

Que transacciones necesitan un completion es decir son del modelo Non-posted?

A
Memory reads
Memory reads lock
AtomicOps
IO reads / writes 
Configuration reads / writes
25
Q

Como se manejan las memory reads con completion?

A

Un completion con dato será devuelto por parte del completer. Devuelve el dato solicitado y estatus de la lectura

Si ocurre un error se devuelve un completion sin dato y con el estatus del error

26
Q

En un AtomicOp que devuelve el completer ?

A

El completion que devuelve contiene dato con el valor original de la locación del target

27
Q

Como se manejan las transacciones IO R/W ?

A

Son del modelo Non-posted, se devuelve un completion sin dato para las lecturas y escrituras que fallaron.
Y un completion con dato para las lecturas exitosas

28
Q

Como se manejan las transacciones de configuration read/write?

A

Son non-posted y el completion que devuelve es sin dato para las lecturas y escrituras que han fallado.
Y se devuelve un completion con dato para las lecturas exitosas.

29
Q

Para que se utilizan los campos de Format y Type en el header?

A

Estos campos definen el tipo de Routing que será implementado y el contenido del header.

30
Q

Como actúa un endpoint en el ID Routing?

A

Es one check el EP solo verifica que el BDF coincida con su Bus y device, si coincide acepta el TLP y el completer tendrá el ID del requester para poder regresar correctamente.

31
Q

Como actúa el switch en el ID Routing ?

A

Hace 2 chequeos por cada puerto en el upstream port compara el BDF si coincide consume el TLP y si no coincide hace el segundo chequeo que es comparar con algún device debajo para esto revisa los registros Secondary y Subordinate

32
Q

Que ocurre si en el ID Routing en BDF no coincide ni con el upstream port del switch y tampoco con los devices que están debajo ?

A

Se considera un Unsupported Request (UR) en el upstream port

33
Q

Como es el Address Routing ?

A

Los paquetes TLPs hacen referencia a la misma memoria MMIO y para modo legacy IO.

34
Q

Que determina que el header para el Routing sea de 3Dw o 4 Dw?

A

Cuando la solicitud de memoria que apunten a direcciones menores de 4GB (32-bit) debe usar 3DW y si apunta mayor a 4GB (64-bit) debe usar 4DW en el header.

35
Q

Como se comporta un endpoint en el ruteo Address Routing?

A

Compara la dirección contenida en el header del TLP contra el rango de direcciones de los BARs del header del device.
Va a aceptar el paquete si la target address coincide o está dentro del rango aceptado programado en el BAR.

36
Q

Como se comporta un switch en un ruteo Address Routing ?

A

Si el puerto determina que la dirección target del TLP coincide con el rango que está en el BAR del header type 1 acepta el TLP.
Si el TLP apunta a una función debajo entonces revisa los registros de Base/Limit.

37
Q

Que es el implicit routing?

A

Es un método que permite una forma simple de ruteo sin necesidad de ID information o de una target address.
Usa algunos paquetes de mensajes que pueden viajar upstream y downstream.

38
Q

Que eventos son considerados por PCIE como mensajes ?

A
Power management 
INTx legacy interrupt signaling
Error signaling 
Locked transactions support 
Hot-plug signaling 
Vendor specific signaling 
Slot power limit settings
39
Q

Porqué los DLLPs y los ordered sets no son routeados?

A

Por que son locales, es decir se mueven en la capa física del link, van de puerto en puerto al llegar a un puerto este consúmenlas secciones DLLP y Ordered Sets, solo se rutea el TLP.

40
Q

Cuáles son los tipos de disparidad?

A
  • Positive disparity. Mayor cantidad de 1’s
  • Negative Disparity. Mayor cantidad de 0’s
  • Neutral disparity. Mismo número de 1’s y 0’s.
41
Q

Qué significan las siglas CRD?

A

Current Running Disparity

42
Q

En que consiste el CRD?

A

Es un valor de 1-bit por lo que solo puede tomar dos valores Y se ajusta en la inicialización, el receptor ve el primer símbolo después del Training, si detecta un error en el CRD sólo le cambia el valor y lo ajusta para coordinar el Tx y Rx.

43
Q

Una vez inicializado el CRD cual es un modo de operación?

A

Si llega un neutral disparity se mantiene el valor y si llega un disparity con valor opuesto el CRD cambia y si llega uno del mismo valor se marca como invalid (no legal).

44
Q

Cuáles son los caracteres de control para manejar o administrar el link en Gen1 y Gen2?

A

COM, PAD, SKP, STP, SDP, END, EDB, FTS, IDL, EIE

45
Q

El nombre de los caracteres de control en la codificación 8b/10b?

A
EDB •••• K30.7
END •••• K29.7
EIE ••••• K28.7
COM ••• K28.5
IDL ••••• K28.3
SDP •••• K28.2
FTS •••••K28.1
SKP •••• K28.0
STP •••• K27.7
PAD •••• K23.7
46
Q

Qué función tiene el caracter COM (comma K28.5)?

A

Es el primer símbolo de la capa física, el receptor lo distingue porque comienza por dos bits en una polaridad y los cinco Bits siguientes con polaridad opuesta.
1100000 o 0011111

47
Q

Qué función realiza el carácter PAD (K23.7)?

A

Se usa en Links con múltiples Lanes, si un paquete no cubre todos los lanes y no hay más paquetes para enviarse, se rellenan estos Lanes sobrantes con símbolos PAD.

48
Q

Para que se utiliza el carácter SKP (skip 28.0)?

A

Este SKIP Ordered set Se envía de forma periódica para facilitar la compensación del reloj.

49
Q

Para que sirve el caracter EDB (K30.7)?

A

EnD Bad. Es insertado para identificar el final de un TLP que algún switch quiere nulificar así el receptor lo ve y descarta el paquete sin retornar Ack o Nak.

50
Q

Para que se inserta el FTS (K28.1)?

A

Fast Training Sequence.

Este ordered set Se envía por el device para recuperar el link del estado L0 stand-by (L0s) de regreso a full-on (L0).

51
Q

Para que se envía el Ordered set IDL (Idle) K28.3?

A

Es parte del Electrical Idle ordered set y se envía para informar al receptor la transición del link a un low Power State.

52
Q

Qué función tiene EIE (Electrical Idle Exit) K28.7?

A

Ayuda al electrical idle link a iniciar el proceso de wake-up, se agregó en PCIE 2.0 spec.

53
Q

Qué son los Ordered sets?

A

Son paquetes que no son ni TLPs tampoco DLLPs, son caracteres que se replican simultáneamente en todos los Lanes del link se utilizan para aspectos del link Training, clock tolerance compensation y cambiar los estados de Link power.